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4 Cards in this Set
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Un'istruzione per ciclo di clock |
Instruztin cycle: tempo impiegato per fare fetch-decode-execte-write di un'istruzione elementare
RISC: hanno un ciclo esecutivo che dura un solo machine cycle, quindi se la pipeline è piena , ad ogni ciclo di clock termina un'istruzione
Istruzioni CISC richiedono più di un ciclo |
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Operazioni da registro a registro, tranne load/store |
- CISC attuali hanno anche operazioni memory to memory e register/memory
- Poiché si usano di frequente scalari locali , aumentando e ottimizzando i registri, la maggior parte degli operandi stanno a lungo nei registri
· Pochi e semplici modi di indirizzamento - Indirizzo di registro , spiazzamento - Si semplifica l'istruzione e l'unità di controllo |
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Pochi e semplici formati fissi per le istruzioni |
- Campi e opcode a dimensione fissa, cosi decodifica dell'opcode e l'accesso ai registri per gli operandi possono essere simultanei - istruzioni a lunghezza fissa sono allineate con la lunghezza delle parole quindi il fetch è ottimizzato per prelevare una parola - la regolarità facilita le ottimizzazioni del compilatore - più responsivo agli interrupt, controllati tra due istruzioni più semplici |
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Unità di controllo cablata |
Se cablata è meno flessibile ma più veloce Se microprogrammata , più flessibile ma meno veloce |
